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| 如何在片上系统(SoC)设计中使用事务处理(二) | |||||
作者:Bassam T… 文章来源:电子系统设计 点击数: 更新时间:2008-1-1 ![]() |
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下面是对图2所示的事务处理进行建模的一个简单代码段。这个类的旨在于将事务处理数据记录到作为trans_db instance dump_file类的事务处理数据库中。输出被显示在图3最右部分。 // Inside program or some other OpenVera context trans_db dump_file; trans_stream stream1; trans_type mem_read; trans_handle h1; // open a database file dump_file=new("test"); // create the memory stream under the test.duv.bus scope stream1=new(dump_file, "test.duv.bus", "memory"); // create the read transaction type in the memory stream mem_read=new(stream1, "Read"); // define 2 attributes in the read transaction type mem_read.create_attr("Addr", INTEGER_DT); mem_read.create_attr("Data", INTEGER_DT); delay(10); // begin a memory read transaction at 10 h1=mem_read.begin_now(); h1.log_integer_attr("Addr", 170); h1.log_integer_attr("Data", 123); delay(20); // end h1 transaction at 20 h1.end_now(); // close the database file dump_file.close(); 当然,正如前面针对SCV所提到的,另一个有用的类是trans_relation,它负责不同事务处理之间的关系。下面的代码段显示出当trans_relation为单向时,类是被怎样运用的。一个分析与可视化工具也可以具备预先定义的关系以便获得对分析和显示的特定表示。 为实现记录,类必须封装事务处理追踪和记录API,使数据库记录细节对用户而言不可见。API必须是开放的,以便在工程师和供应商等人之间培养出一种公共增值文化。在创建、生成和记录事务处理时,它也必须经受得起跨语言应用的检验,从而给设计工程师一个高价值工具。而且它必须简单、基本,但是要足够宽泛以便覆盖事务处理记录的基本要素。为获得某些(特定建模语言)具体功能,可以另外在封装之上再建立API。 SystemVerilog(3.1a版)(www.systemverilog.org)是新型的设计建模与测试台语言。它目前没有如SystemC里的内置事务处理类别,但是它存在的目的就是将Verilo电路和寄存器数据抽象化并封装至更有意义的分组数据中。这使得我们有必要看看如何才能建模然后记录事务处理数据。事实上,可以采用多种方法在SystemVerilog实现这一点:a)等待增添内置类的标准化努力。这也许会最终发生,不过SystemVerilog今天就可以达到这一目的。因此何必还要等待概念产生然后再期待供应商去支持它呢?b)创建你自己的事务处理类和方法(任务和功能),然后也许再将其作为一个可分享的函数库捐赠给业界。c)透过直接编程接口(DPI)或编程语言接口来与SystemC集成。d)在建模过程中调用“系统任务”在恰当的地方完成。 |
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